【摘 要】
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本设计以ARM为核心,控制FPGA实现直接数字频率合成功能.FPGA内部的地址累加器作为相位数据,以查表方式得到幅度数据,通过高速D/A转换器和高速运放得到所需输出信号波形.输出
【机 构】
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浙江乐清市质量技术监督检测院,乐清,325604
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本设计以ARM为核心,控制FPGA实现直接数字频率合成功能.FPGA内部的地址累加器作为相位数据,以查表方式得到幅度数据,通过高速D/A转换器和高速运放得到所需输出信号波形.输出信号的幅度调节则由模拟开关控制电阻网路实现.系统采用串行键盘进行参数设置,由LCD实时显示输出波形及设置信息.FP-GA基准时钟采用51.2MHz有源晶振,通过FPGA内部锁相环,为系统提供140.8MHz的高频时钟信号.
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