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设计并实现了适用于家庭安全网关的HMAC SHA3算法的快速、高效、且结构紧凑的硬件电路。该硬件电路可支持任意长度字节的数据包,并能正确计算出摘要值。处理一组长度为512 bit数据仅需要130个时钟数。在Arriv V开发板上,整个硬件电路最大时钟频率能达到145.67 MHz。
适用于家庭安全网关的HMAC SHA3算法的硬件设计
【摘 要】
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设计并实现了适用于家庭安全网关的HMAC SHA3算法的快速、高效、且结构紧凑的硬件电路。该硬件电路可支持任意长度字节的数据包,并能正确计算出摘要值。处理一组长度为512 bi
【机 构】
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通信信息控制和安全技术重点实验室,中国电子科技集团公司第三十六研究所,华中科技大学光学与电子信息学院
【出 处】
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集成电路应用
【发表日期】
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2020年5期
【基金项目】
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浙江省高新技术企业科技创新课题项目
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