JPEG2000中算术编码器的FPGA实现

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【摘要】

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研究了JPEG2000标准中算术编码器的硬件实现问题,提出了一种适合VLSI实现的结构,并在FPGA上对其进行了仿真验证.该设计使用Verilog语言在RTL级描述;并以Altera FLEX10K100-3

【作者】

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李德建孟鸿鹰王志华

【机构】

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清华大学

【出处】

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微电子学

【发表日期】

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2002年4期

【关键词】

：

算术编码器 FPGA JPEG2000 图像压缩 Arithmetic encoder FPGA JPEG2000 Image compression

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研究了JPEG2000标准中算术编码器的硬件实现问题,提出了一种适合VLSI实现的结构,并在FPGA上对其进行了仿真验证.该设计使用Verilog语言在RTL级描述;并以Altera FLEX10K100-3为基础,在Maxplus II下完成综合及后仿真.综合得到的器件面积利用率16%,最高工作时钟31.4 MHz.分析表明,这种结构能够满足JPEG2000系统对512×512的灰度图像数据进行实时处理的要求.

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