常系数乘法器的VLSI高效设计

来源 :军民两用技术与产品 | 被引量 : 0次 | 上传用户：wutiepeng

【摘要】

：

符号数的正则表示(CSD)是一种用最少的非零比特位来表示符号数的编码技术.介绍了一种基于二进制补码数实现CSD编码的转换算法.通过采用多种优化技术,提出了基于CSD编码技术的

【作者】

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熊承义高志荣田金文

【机构】

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华中科技大学图像所,武汉科技学院计算机系,华中科技大学图像所

【出处】

：

军民两用技术与产品

【发表日期】

：

2003年9期

【关键词】

：

高速乘法器正则符号数 VLSI 设计硬件描述语言数字信号处理编码 Fixed- coefficient multiplier Canonic Sign

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符号数的正则表示(CSD)是一种用最少的非零比特位来表示符号数的编码技术.介绍了一种基于二进制补码数实现CSD编码的转换算法.通过采用多种优化技术,提出了基于CSD编码技术的常系数乘法器的VLSI高效设计.采用Verilog硬件描述语言实现了一组小波滤波器的乘法单元的RTL描述,在Xilinx ISE4.1环境下对设计进行了功能仿真、综合和FPGA原型实现.

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