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提出了满足大整数相乘的CORDIC算法的改进措施,给出了改进后算法的VLSI结构及其VHDL代码的仿真时序,与理论计算结果相比较,修正后的CORDIC算法的大整数乘积运算结果与理论计算结果基本一致,可以满足数字系统设计中对大整数相乘设计要求。
基于CORDIC算法的乘法器的VLSI实现
【摘 要】
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提出了满足大整数相乘的CORDIC算法的改进措施,给出了改进后算法的VLSI结构及其VHDL代码的仿真时序,与理论计算结果相比较,修正后的CORDIC算法的大整数乘积运算结果与理论计
【机 构】
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陕西移动通信公司安康分公司,陕西理工学院电信工程系,陕西理工学院数学系
【出 处】
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陕西理工学院学报：自然科学版
【发表日期】
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2010年2期
【基金项目】
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国家自然科学基金资助项目（60703118）, 陕西省教育厅自然科学研究基金资助项目（08JK254）, 陕西理工学院人才启动基金资助项目（SLGQD0802）
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