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介绍一种基于虚拟仪器技术的逻辑分析仪控制电路的设计和Verilog HDL的实现方法.概述虚拟逻辑分析仪的系统总体结构和工作原理,详述控制电路的设计和部分功能模块,给出时钟选择、触发识别与存储控制的Verilog HDL的设计代码,并给出了顶层模块仿真图.
虚拟逻辑分析仪控制电路的设计与实现
【摘 要】
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介绍一种基于虚拟仪器技术的逻辑分析仪控制电路的设计和Verilog HDL的实现方法.概述虚拟逻辑分析仪的系统总体结构和工作原理,详述控制电路的设计和部分功能模块,给出时钟选
【机 构】
：
东南大学电气工程系,210096
【出 处】
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电气应用
【发表日期】
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2005年12期
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