基于FPGA的高速AES实现

来源 :华中科技大学学报(自然科学版) | 被引量 : 0次 | 上传用户:ydaf4rx3
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通过对高级数据加密标准进行分析,给出了一种基于全流水线的的实现方法.这种实现方法同时支持加密和解密,具有低实现代价、高吞吐量等特点.采用Xilinx公司的Virtex-4 XC4VLX 1000-12芯片进行实现,结果表明吞吐量可以达到39.93 Gbit/s,适合高性能的加密应用要求. By analyzing the advanced data encryption standard, an implementation method based on full pipelining is proposed, which implements encryption and decryption with low cost, high throughput, etc. The Xilinx Virtex-4 XC4VLX 1000-12 chip implementation, the results show that the throughput can reach 39.93 Gbit / s, suitable for high-performance encryption applications.
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