基于FPGA的伪码快速搜索系统的研究与设计

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针对基于CDMA导频的无源定位系统所涉及的伪码搜索问题,提出利用先验信息加快伪码搜索速度的策略;依照该策略重点完成了伪码搜索系统的FPGA设计;该设计通过一个时序控制模块较好地解决了PN码发生器与算术逻辑单元的协调配合、PN码的捕获与跟踪、算术逻辑单元的分时复用等技术问题;通过QuartusⅡ与ModelSim的联合仿真,验证了该策略及其在FPGA设计中的正确性,同时表明了系统在一20dB的高斯白噪声干扰下,进行伪码搜索的时间小于100ms,码片同步精度小于1/8码片宽度。
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