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期刊论文
基于System Verilog的NoC测试平台
基于System Verilog的NoC测试平台
来源 :计算机工程 | 被引量 : 0次 | 上传用户:lcsuoboger
【摘 要】
:
针对片上网络(NoC)验证效率不高的问题,依据验证方法学,利用System Verilog语言的优势,构建一个由覆盖率驱动并受约束的随机分层NoC测试平台。在不同拓扑结构和流量分布下,对No
【作 者】
:
柯夏志
张颖
【机 构】
:
南京航空航天大学电子信息工程学院
【出 处】
:
计算机工程
【发表日期】
:
2011年23期
【关键词】
:
SYSTEM
VERILOG语言
片上网络
验证方法学
测试平台
功能覆盖率
SystemVerilog language Network on Chip(No
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针对片上网络(NoC)验证效率不高的问题,依据验证方法学,利用System Verilog语言的优势,构建一个由覆盖率驱动并受约束的随机分层NoC测试平台。在不同拓扑结构和流量分布下,对NoC进行性能评估,结果证明该测试平台具备较强的通用性、适应性和扩展性,能有效地提高验证效率。
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