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本文介绍了基于P6总线的多处理器系统的总线事务和存储区的Cache属性,讨论了P6总线的硬件监听机制,PentiumⅢ处理器所采用的MESI状态转换,最后研究了多处理器和P6总线如何相互配合以保证整个系统的Cache一致性.
基于P6总线的多处理器系统Cache一致性设计
【摘 要】
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本文介绍了基于P6总线的多处理器系统的总线事务和存储区的Cache属性,讨论了P6总线的硬件监听机制,PentiumⅢ处理器所采用的MESI状态转换,最后研究了多处理器和P6总线如何相
【机 构】
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信息存储系统教育部重点实验室
【出 处】
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计算机科学
【发表日期】
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2004年4期
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