面向无线传感器网络高效率CMOS功率放大器设计

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近年来,随着传感器设备和无线通信技术的发展,无线传感器网络受到了极大的关注。无线传感器网络的广泛使用使得远程监控物理环境变得更加容易,但是其低功耗、小成本与有限的网络寿命等特点为收发机系统带来了一系列挑战,尤其是对片上功率放大器的设计提出了很高的要求。基于这一背景,本论文对高效率CMOS功率放大器展开了研究。本论文分析了功率放大器在无线传感网络中的应用,对当前国内外提出的CMOS功率放大器所使用的架构、技术与性能等进行了调研,介绍了功率放大器的分类与性能参数等电路设计基本理论,并规划了功率放大器的设计指标。然后对需要考虑的设计要点进行了分析,包括晶体管的非线性特性与电路的阻抗匹配技术等,并提出相应的高效率、线性化提升技术。在此基础上,本论文提出了一款在具有高效率CMOS功率放大器。该功率放大器采用单端两级级联结构,驱动级与功率级均采用自偏置共源共栅结构,降低了击穿风险,增大了输出电压摆幅并提高反向隔离度。功率级偏置为深AB类,提高了电路的效率并保证了一定的线性度。驱动级电路采用电容补偿技术来解决晶体管栅源寄生电容引起的非线性效应,利用RC负反馈技术将电路的增益与线性度进行折中。输入电路利用负载牵引技术选取了最佳负载阻抗值,并使用低通L型匹配网络将50Ω变换为最佳负载阻抗值,将对电路的高阶谐波非线性信号进行抑制,并使得电路最终同时达到了较高的输出功率与功率附加效率。本设计基于SMIC 55nm RF CMOS工艺,利用Cadence Virtuoso软件完成了整体2.4 GHz功率放大器电路的前后仿真,并使用工艺角仿真分析了元器件偏差对电路性能的影响。为了减弱片上电感的寄生效应带来的影响,本设计还对电路关键模块进行了电磁仿真优化,并搭建了Cadence与Sonnet电磁联合仿真平台对电路进行电磁联合仿真验证。最终电路的芯片面积为0.635 mm2,S11<-11.6 d B,输入1d B压缩点为1.5 d Bm,饱和输出功率为13.1 d Bm,功率附加效率PAE为46%,均能够满足性能指标。
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