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本文通过介绍一个JPEG解码器实现过程，来说明超大规模集成电路知识产权核的设计，使其在最短的时间内，实现单个芯片上的多功能性。
基于FPGA的集成电路IP开发
【摘 要】
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本文通过介绍一个JPEG解码器实现过程，来说明超大规模集成电路知识产权核的设计，使其在最短的时间内，实现单个芯片上的多功能性。
【机 构】
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北京航空航天大学软件学院,北京 100083
【出 处】
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全国第一届信号处理应用学术会议
【发表日期】
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2007年3期
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