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介绍了一种12位高速、低失真数字/模拟转换器(DAC)的设计原理及其电路结构;着重阐述了去毛刺技术及其应用.采用2 μm等平面隔离互补双极工艺模型参数进行了Cadence仿真.结果表明,该12位DAC在高达60 MHz数据更新率下具有低于100pV·s的毛刺脉冲面积.
一种12位高速低失真数字／模拟转换器的设计
【摘 要】
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介绍了一种12位高速、低失真数字/模拟转换器(DAC)的设计原理及其电路结构;着重阐述了去毛刺技术及其应用.采用2 μm等平面隔离互补双极工艺模型参数进行了Cadence仿真.结果
【机 构】
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中国电子科技集团公司第二十四研究所
【出 处】
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微电子学
【发表日期】
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2004年3期
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