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本文介绍了一种8位高速微控制器IP软核的设计，该IP采用哈佛总线和二级流水线，指令集与PIC16F676兼容。本文按照自顶而下的设计流程，首先定义了该MCUIP核的顶层功能和体系结构，然后对各单元模块进行了详细的设计，讲述了IP软核的设计方法及其仿真验证，并对该微控制器的读／写时序进行了分析。
8位高速微控制器IP软核的设计与实现
【摘 要】
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本文介绍了一种8位高速微控制器IP软核的设计，该IP采用哈佛总线和二级流水线，指令集与PIC16F676兼容。本文按照自顶而下的设计流程，首先定义了该MCUIP核的顶层功能和体系结构，然
【机 构】
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成都电子科技大学微电子与固体电子学院
【出 处】
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电子设计应用
【发表日期】
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2007年3期
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