【摘 要】
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在锁相环设计中,双模前置分频器(dual-modulus prescaler)是一个速度瓶颈,而D触发器是限制其速度的主要因素.我们对传统的Yuan-Svensson 真正单相时钟(TSPC)D触发器(DFF)做了
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在锁相环设计中,双模前置分频器(dual-modulus prescaler)是一个速度瓶颈,而D触发器是限制其速度的主要因素.我们对传统的Yuan-Svensson 真正单相时钟(TSPC)D触发器(DFF)做了改进,给出了动态有比D触发器的结构,该触发器结构简单,工作频率高,功耗低.并基于此设计了一个可变分频比双模前置分频器,可适用于多种无线通信标准.采用0.35 μm CMOS工艺参数进行仿真,结果表明,在3.3 V电源电压下其工作频率可达4.1 GHz.
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