高速AD转换器的数字电路设计

来源 :浙江省电子学会2007年学术年会 | 被引量 : 0次 | 上传用户：jackieWXM

【摘要】

：

介绍用于高速高分辨率流水线结构的模数转换器的数字电路.该数字电路包括时钟发生器和数字校正电路.时钟发生器产生采用的是两路延迟单元负反馈得到;数字校正电路采用改进的

【作者】

：

朱芸郭裕顺

【机构】

：

杭州电子科技大学电子信息学院,浙江,杭州,310018

【出处】

：

浙江省电子学会2007年学术年会

【发表日期】

：

2007年11期

【关键词】

：

模数转换器高速A/D转换器数字电路时钟发生器数字校正电路电路设计

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介绍用于高速高分辨率流水线结构的模数转换器的数字电路.该数字电路包括时钟发生器和数字校正电路.时钟发生器产生采用的是两路延迟单元负反馈得到;数字校正电路采用改进的流水线操作方式,以期达到减少延迟单元,节省硬件功耗,降低误差操作.该数字电路在0.6μmCMOS工艺中能满足高速ADC的时序要求,并对各级输出的数据在同步时钟的控制下进行加法运算,最终将输入的模拟信号转换成数字信号输出.

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