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提出了一种实现高速并行Viterbi译码器的结构,并且将SMDO法[1]用于幸存路径存储和输出模块部分.本设计已基于FPGA得以实现,获得了译码速度快、延时小的效果.
Viterbi译码器的FPGA实现技术研究
【摘 要】
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提出了一种实现高速并行Viterbi译码器的结构,并且将SMDO法[1]用于幸存路径存储和输出模块部分.本设计已基于FPGA得以实现,获得了译码速度快、延时小的效果.
【机 构】
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哈尔滨工程大学
【出 处】
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应用科技
【发表日期】
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2003年5期
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