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JPEG2000算术解码器的VLSI实现
JPEG2000算术解码器的VLSI实现
来源 :电子科技大学学报 | 被引量 : 0次 | 上传用户:toelfdd
【摘 要】
:
介绍了JPEG2000编解码流程以及JPEG2000算术编码的原理.针对传统算术解码器过慢的情况,提出了一种动态的流水线算术解码器结构,给出了相应的硬件实现的框图,该结构通过FPGA验证,采
【作 者】
:
方晗
黄全平
周荣政
洪志良
【机 构】
:
复旦大学专用集成电路国家重点实验室
【出 处】
:
电子科技大学学报
【发表日期】
:
2006年6期
【关键词】
:
JPEG2000
算术编码器
流水线
MQ编码
JPEG2000
arithmetic coding
pipeline
MQ coder
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介绍了JPEG2000编解码流程以及JPEG2000算术编码的原理.针对传统算术解码器过慢的情况,提出了一种动态的流水线算术解码器结构,给出了相应的硬件实现的框图,该结构通过FPGA验证,采用了TSMC 0.25μm工艺,进行了ASIC的实现.
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