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改进BM算法的高速RS译码器方案及其FPGA实现
改进BM算法的高速RS译码器方案及其FPGA实现
来源 :电声技术 | 被引量 : 12次 | 上传用户:heyifeizhu
【摘 要】
:
介绍了一种高速的RS译码器的结构方案。由于一般BM算法的实现结构不规则,以及延时过长的缘故,在VLSI的设计中,广泛采用的是eE算法,采用的改进BM算法,使得BM算法的实现结构规则,并且延时更小。另外还采用了一种新的有限域乘法结构,有规则的结构,易于HDL语言实现。
【作 者】
:
郑文杰
李磊
冯穗力
叶梧
【机 构】
:
华南理工大学电子与通信工程系
【出 处】
:
电声技术
【发表日期】
:
2007年06期
【关键词】
:
前向纠错
RS码
有限域乘法器
BM算法
FEC Reed-solomen codes GF multiplier Berlekamp-Massey algor
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介绍了一种高速的RS译码器的结构方案。由于一般BM算法的实现结构不规则,以及延时过长的缘故,在VLSI的设计中,广泛采用的是eE算法,采用的改进BM算法,使得BM算法的实现结构规则,并且延时更小。另外还采用了一种新的有限域乘法结构,有规则的结构,易于HDL语言实现。
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