【摘 要】
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SERDES(串行解串)技术因其传输速率高、抗干扰能力强等优点已成为主流的高速接口物理层规范。但由于上层PCS(物理编码子层)需设置弹性缓冲、编解码等功能,导致系统传输延时较
【机 构】
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中国科学院上海高等研究院,上海大学计算机工程与科学学院,上海芯来电子科技有限公司,数学工程与先进计算国家重点实验室
【基金项目】
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数学工程与先进计算国家重点实验室开放基金项目(2018A01).
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SERDES(串行解串)技术因其传输速率高、抗干扰能力强等优点已成为主流的高速接口物理层规范。但由于上层PCS(物理编码子层)需设置弹性缓冲、编解码等功能,导致系统传输延时较高,无法直接应用于处理器直连等延迟敏感应用领域。介绍了一种基于同源相位补偿缓冲(Synchronous Phase Compensation Buffer,SPCB)的PCS架构的设计实现,可应用于延时敏感的SERDES接口传输系统。该架构具有高吞吐率和超低延时的特点,通过定制的SPCB,单通道32Gb/s时,发送与接收通路传输延时为
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