基于FPGA／SOPC—Nios Ⅱ的频率计数器设计

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【摘要】

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本设计以Altera FPGA系列Cyclone EP1C6Q240器件为载体，通过SOPC技术构建嵌入式软核Nios Ⅱ处理器平台，运用VHDL语言设计计数模块，利用等精度测量技术完成对1Hz～100MHz周期信号的

【作者】

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利剑清宋跃林明仁张志坚

【机构】

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东莞理工学院电子工程系

【出处】

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东莞理工学院学报

【发表日期】

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2008年3期

【关键词】

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FPGA/SOPC 软核处理器Nios Ⅱ 等精度测量频率计数器 FPGA/SOPC soft-core processor equal accuracy

【基金项目】

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东莞市2006年科技计划项目（第2批序号11）,东莞市科研发展专项资金项目（2005D040）.

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本设计以Altera FPGA系列Cyclone EP1C6Q240器件为载体，通过SOPC技术构建嵌入式软核Nios Ⅱ处理器平台，运用VHDL语言设计计数模块，利用等精度测量技术完成对1Hz～100MHz周期信号的精度为8×10^-6的周期和频率的测量，同时采用闸门测量技术完成脉宽、占空比的测量，重点介绍了等精度计数模块与SOPC技术的设计与实现的方法．

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