【摘 要】
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针对DDR3的灵活性与使用效率问题,提出了一种DDR3上的双读写通道设计与实现策略。在DDR3上切割出两套独立读写通道,基于时分复用(TDM)原则,使每套读写状态互不影响,能按要求
【机 构】
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西南科技大学信息工程学院,西华师范大学商学院
【基金项目】
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国家重大科学仪器设备开发基金资助项目(2016YFF0104003)
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针对DDR3的灵活性与使用效率问题,提出了一种DDR3上的双读写通道设计与实现策略。在DDR3上切割出两套独立读写通道,基于时分复用(TDM)原则,使每套读写状态互不影响,能按要求完成用户任意读写指令。设计了一种时分复用桥接电路,通过数据切换器,使两套用户读写接口分时的与DDR3控制器接口相连接。将DDR3 IP核MIG提供的一套控制接口搭建为两套独立的用户读写接口,分时间片轮循执行用户读写命令,能总体实现对DDR3的同时读写操作。板级测试表明,DDR3内部读写时钟达800MHz,外部用户接口操作时钟达2
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