嵌入式SRAM的低功耗优化及测试

来源 :计算机科学 | 被引量 : 0次 | 上传用户：flyindirty2008

【摘要】

：

为了降低SRAM的功耗，提出了一种优化的SRAM。对改变较快的输入端引入操作数隔离技术，对比较电路的多位数据进行总线数据分割；给较大的时钟网络增加门控时钟，引入多种电源控制模式

【作者】

：

王江安庄奕琪靳钊李迪

【机构】

：

西安电子科技大学宽禁带半导体材料与器件国家重点实验室

【出处】

：

计算机科学

【发表日期】

：

2010年7期

【关键词】

：

低功耗操作数隔离总线数据分割电源控制模式旁路逻辑 Low power Isolation of operation data Division of

【基金项目】

：

本文受863国家重点基金项目（2003AA1Z1410）,国家自然科学基金（60276028）资助.

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为了降低SRAM的功耗，提出了一种优化的SRAM。对改变较快的输入端引入操作数隔离技术，对比较电路的多位数据进行总线数据分割；给较大的时钟网络增加门控时钟，引入多种电源控制模式并增加隔离逻辑；将SRAM64K×32分解为8个SRAM8K×32子块，由八选一逻辑通过各子块的片选信号相连，使得同时只有一个子块处于读写状态。将优化的SRAM64K×32应用到SOC中，并通过增加旁路逻辑来测试各部分功耗。该SOC经90nmCMOS工艺成功流片。测试结果表明，优化的SRAM64K

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