【摘 要】
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为了解决在RS译码中存在的译码过程复杂、译码速度慢和专用译码器价格高等问题,以RS（255,239）码为例,采用了基于改进的无求逆运算的Berlekamp-Massey（BM）迭代算法。结合FPGA平台,
【机 构】
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上海微小卫星工程中心,上海科技大学信息学院
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为了解决在RS译码中存在的译码过程复杂、译码速度慢和专用译码器价格高等问题,以RS（255,239）码为例,采用了基于改进的无求逆运算的Berlekamp-Massey（BM）迭代算法。结合FPGA平台,利用Xilinx ISE软件和Verilog硬件描述语言,对译码器中各个子模块进行了设计和仿真。整个译码器设计过程采用流水线处理方式。时序仿真结果表明在保证错误符号不大于8个的情况下,经过295个固有延迟之后,每个时钟周期均可连续输出经校正的码字,该RS译码器的纠错能力能够达到预期要求。
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