基于FPGA IP核的FFT实现与改进

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利用FPGA IP核设计了一种快速、高效的傅里叶变换系统。针对非整数倍信号周期截断所导致的频谱泄露问题,提出了一种通过对输入信号加窗处理来抑制频谱泄露的方法。利用Modelsim和Matlab对设计方案进行了仿真,同时在Altera公司的Cyclone II硬件平台上进行了验证。验证结果表明,系统性能良好,改进效果明显。
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