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传统上,数字逻辑的静态功耗不会很高,然而在非常小的工艺节点上,这种情况发生了变化.随着工艺尺寸的降低,数字逻辑的泄漏电流成为FPGA面临的主要挑战.虽然迈向65nm工艺实现了摩尔定律预言的密度和性能优势,但是性能的提高也会显著增加功耗,有可能出现无法承受的高功耗.
Stratix Ⅲ可编程功耗优化技术
【摘 要】
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传统上,数字逻辑的静态功耗不会很高,然而在非常小的工艺节点上,这种情况发生了变化.随着工艺尺寸的降低,数字逻辑的泄漏电流成为FPGA面临的主要挑战.虽然迈向65nm工艺实现了
【机 构】
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Altera亚太区产品市场
【出 处】
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电子设计技术
【发表日期】
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2007年3期
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