【摘 要】
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基于1 bin/周期吞吐率CABAC硬件编码器结构,采取旁路编码bin（BB）编码加速设计可进一步提升CABAC编码性能。通过功能合理划分的ARR、ARL两级流水线结构,并有效控制电路关键路径
【出 处】
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武汉理工大学学报(信息与管理工程版)
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基于1 bin/周期吞吐率CABAC硬件编码器结构,采取旁路编码bin（BB）编码加速设计可进一步提升CABAC编码性能。通过功能合理划分的ARR、ARL两级流水线结构,并有效控制电路关键路径长度,实现了单周期N-BB编码、单周期1RB＋1BB两种BB编码加速技术。在相同时钟频率条件下将CABAC编码器BB编码周期数降低到参考设计的2%,并使CABAC编码器的流水线吞吐率提升18%,达到1.18 bin/周期,编码器绝对吞吐率实现682 Mbin/s,而电路面积相对于原编码器仅增加4%。
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