关于除法器的FPGA算法实现

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研究表明,与IC组成的系统相比,由于SOC设计能够综合并全盘考虑整个系统的各种情况,因而可以在同样的工艺技术条件下,实现更高性能的系统指标。除了系统使用的资源外,可编程器件内还具有足够的可编程逻辑资源,用于实现其他的附加逻辑。Altera的SOPC开发工具,将软硬件的设计结合起来,提供给客户一个很好的开发环境。其中的设计工具SOPC Builder更是开创了嵌入式系统设计的新理念。在Altera的NIOS嵌入式处理器中,用户可以在NIOS指令系统中增加用户自定义指令,以增强其对强实时软件算法的处理能力。另外,增加的用户自定义指令同样可以访问存储器或NIOS系统外的逻辑。采用用户自定义指令,用户可以把一个复杂的标准指令序列,简化为一条用硬件实现的单个指令。借助Nios自定制指令的这个特性,Nios的开发者可以设计功能异常强大的自定制指令。所有4种基本运算中除法器是最复杂的。因此除法器也是最耗时间的运算,而且还要实现的最大数量的不同算法的运算。本章采用两种方案实现二进制除法器比较其性能,速度及占用的资源。一种是线性收敛的除法算法,另一种是快速收敛的除法算法。在SOPC Builder中进行自定义8位收敛除法器指令的添加,并得出结论。
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