【摘 要】
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本文详细讨论了不同基下乘法器设计的复杂度。在有限域计算中,乘法运算是结构最复杂,时间延迟最大的运算,因此乘法器的设计是RS编译码的重点,这样不同基下RS码编译码设计的差
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本文详细讨论了不同基下乘法器设计的复杂度。在有限域计算中,乘法运算是结构最复杂,时间延迟最大的运算,因此乘法器的设计是RS编译码的重点,这样不同基下RS码编译码设计的差异主要就体现在不同基下乘法器设计的差异。本文的主要内容还包括RS(255,239)编译码器的设计,编码器的设计主要有乘法器,加法器,8位并入并出移位寄存器,256进制计数器,8位2选1数据选择器模块的设计。译码部分采用Berlekamp迭代算法来求解关键方程,chien搜索算法求得错误位置多项式σ(x),Forney算法得到错误图样,最后给出译码器的输出。本文以VHDL语言为开发平台,完成RS(255,239)编译码器的硬件结构及FPGA实现。
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