基于DSP的HEVC实时解码器的优化与实现

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随着数字视频应用产业链的快速发展,现有的视频压缩技术已经不能满足人们日益增长的体验需求,用户希望看到高清晰度、高帧率、高压缩率的视频。在此背景下本文提出了以下研究目标:以HEVC(High Efficiency Video Coding)视频编解码标准为基础,实现1080P视频解码速度在25帧/秒以上的DSP(Digital Signal Process)实时解码器。为达成这一目标,本文主要进行了四部分工作。第一部分是解码原理的研究。本文研究了 HEVC混合编码框架和用到的关键技术,为解码系统的优化与实现提供了理论基础。第二部分是视频解码的优化。在理论研究的基础上,本文对HEVC解码器的实现进行了 C语言优化和DSP优化两部分工作:C语言优化主要包含架构、内存和性能三方面的优化,DSP优化主要包含指令集、软件流水循环技术和Cache的运用。这些工作成倍地提高了解码器各个模块的性能,为实时解码系统的实现打下了良好的基础。第三部分是视频传输的适配。本文在HEVC标准中网络适配层的基础上,提出了一种基于RS码(Reed-Solomoncodes)的传输适配方案:采用冗余包重复传递来保护重要视频信息,采用纠错能力极强的RS码来恢复信道传输带来的差错及丢失信息。本文阐述了 RS编译码原理及实现过程,然后通过C语言和DSP优化在单核DSP上实现了 10M码率、25帧/秒以上的实时译码性能。第四部分是多核系统的实现。在前两部分优化工作的基础上,本文研究了 HEVC并行处理的实现方式,从均衡负载、减少数据吞吐量和减少延时三个出发点设计了多核系统架构,阐述了系统工作原理及核间通信机制。该系统充分发挥了多核处理器的性能,测试1080P视频的解码速度达到了 25帧/秒以上,从而达到了论文的研究目标。这一目标的实现是极具实用价值和研究意义的。一方面为DSP平台上的实时解码提供了可能,这将在高清视频领域带来广阔的应用前景;另外一方面,本文提出的优化方案和多核并行架构也为其他平台的实现和实时编码器的实现带来了极大的参考价值和研究意义。
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