AVS视频解码器中去块效应环路滤波模块的硬件设计

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数字视频技术在通信和广播领域有着广泛的应用,特别在二十世纪九十年代以来,伴随互联网和移动通信技术的飞速发展,视频在互联网和移动网络中的处理和传输技术成为我国信息化建设中的热点。为了避免H.264等国际标准高昂的专利费用,满足我国信息产业发展的需求,我国自2002年起开始组织相关企业和科研机构制定我们自己的音视频压缩标准AVS。本文回顾了AVS的发展历程,介绍了其特点、优势、关键技术以及对我国信息产业的重大意义。由于AVS标准采用基于块的整数变换、量化和运动补偿技术,所以不可避免引入了块效应,使图像质量下降,编码效率降低,为去除块效应,AVS标准采用了环路滤波技术。本文在对AVS标准中环路滤波算法仔细分析的基础上,使用Verilog HDL硬件描述语言对环路滤波部分进行了硬件设计。由于环路滤波在条带级,宏块边界级,像素级的自适应性特点,使得环路滤波的运算复杂度高,速度慢,所以在宏块处理和边界滤波过程中采用了流水线设计,以提高处理速度。同时通过对水平边界和垂直边界像素的再分配,能够使用同一个滤波器,进行边界滤波,节约了资源。采用自顶向下的设计方法,划分了子模块,对各子模块进行仿真,进行了FPGA综合,对宏块滤波所需时钟周期进行了分析。经测试,该设计运行正常,结果正确,符合实时解码要求。
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