【摘 要】
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本文用寄存器交换法实现了Viterbi译码,并用Verilog硬件描述语言具体设计实现,在很多细节上做了优化和改进,译码速率大大增加.为了适应各种情况,很多参数在编译前可配置.分别
【机 构】
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国防科技大学计算机学院 长沙 410073
【出 处】
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第十二届计算机工程与工艺全国学术年会(NCCET'08)
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本文用寄存器交换法实现了Viterbi译码,并用Verilog硬件描述语言具体设计实现,在很多细节上做了优化和改进,译码速率大大增加.为了适应各种情况,很多参数在编译前可配置.分别利用ModelSim 6.0和XilinxISE9.1i软件进行仿真和综合,译码器的最大数据输出频率可达近200MHz.利用Haps板在真实系统中进行测试,实验结果表明,该体系结构,降低了误码率以及译码器实现的复杂度,切实可行.
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