【摘 要】
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为了适应高速率通信系统的发展要求,Turbo码可采用并行译码的结构方式来降低时延。然而在并行Turbo码译码中,交织器的随机特性可能会导致多个数据同时写入同一个存储器,这就
【机 构】
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南京工业大学信息科学与工程学院,南京工业大学信息科学与工程学院 江苏南京210009,江苏南京210009
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为了适应高速率通信系统的发展要求,Turbo码可采用并行译码的结构方式来降低时延。然而在并行Turbo码译码中,交织器的随机特性可能会导致多个数据同时写入同一个存储器,这就造成了存储器的访问冲突。如何设计出无冲突交织器是并行Turbo译码器的设计难点。文中对当前国内外的并行Turbo译码无冲突交织器设计方案进行了综述,对几种新的交织器分析研究。
In order to meet the development requirements of high-speed communication systems, Turbo codes can use parallel decoding structure to reduce the delay. However, in the parallel decoding of Turbo codes, the random characteristics of the interleaver may cause multiple data to be written to the same memory at the same time, which leads to a memory access conflict. How to design a non-conflicting interleaver is a difficult design of parallel Turbo decoder. In this paper, the current domestic and international parallel Turbo decoding conflict-free interleaver design are reviewed, and several new interleaver analysis and research.
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