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A parallel complex divider architecture based on DCD iterations for computing complex division in MV

来源 :系统工程与电子技术:英文版 | 被引量 : 0次 | 上传用户：wangxiaomax

【摘 要】

：

This paper presents a hardware architecture using mixed pipeline and parallel processing for complex division based on dichotomous coordinate descent(DCD)iterat

【作 者】

：

KIDAV Jayaraj U SIVA Mangai N 

【机 构】

：

KarunyaInstituteofTechnologyandSciences,NationalInstituteofElectronicsandInformationTechnology

【出 处】

：

系统工程与电子技术:英文版

【发表日期】

：

2018年6期

【关键词】

：

minimum variance distortionless response(MVDR)beamformer adaptive weight dichoto 

【基金项目】

：

Microelectronics Division of theMinistry of Electronics and Information Technology,Government of India,under SMDP-C2SD Project(9(1)/2014–MDD).

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This paper presents a hardware architecture using mixed pipeline and parallel processing for complex division based on dichotomous coordinate descent(DCD)iterations.The objective of the proposed work is to achieve low-latency and resource optimized comple

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