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通过研究几种高速Viterbi译码器的ACS(加比选)单元的结构,提出一种ACS单元新的设计方法。设计中采用Radix-4网格结构,能提高译码器的吞吐量;而简单的逻辑可以有效降低译码器的资源占用率。
Viterbi译码器ACS单元的一种新设计
【摘 要】
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通过研究几种高速Viterbi译码器的ACS(加比选)单元的结构,提出一种ACS单元新的设计方法。设计中采用Radix-4网格结构,能提高译码器的吞吐量;而简单的逻辑可以有效降低译码器
【机 构】
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清华大学电子工程系
【出 处】
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电视技术
【发表日期】
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2006年08期
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