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提出了一种固定码长的多码率多边LDPC码译码器，该译码器采用对校验比特信息进行间隔删余的算法实现其多码率译码，并设计了一种适合多码率多边LDPC码的部分并行译码结构。基于该结构在FPGA平台上实现了码长为640bit，码率为0．5～0．8的多边LDPC码译码器。
多码率多边类型LDPC码译码器的设计与实现
【摘 要】
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提出了一种固定码长的多码率多边LDPC码译码器，该译码器采用对校验比特信息进行间隔删余的算法实现其多码率译码，并设计了一种适合多码率多边LDPC码的部分并行译码结构。基于该
【机 构】
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重庆邮电大学重庆市移动通信重点实验室,重庆邮电大学通信与信息工程学院,重庆电子工程职业学院软件工程系,厦门大学宽带无线通信实验室
【出 处】
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电视技术
【发表日期】
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2011年15期
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