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介绍了利用VHDL实现八位除法,采用层次化设计,给出了实现除法的子模块程序。使用Altera公司的MAX+PLUSI-I10.2开发软件进行功能仿真并给出仿真波形。
基于VHDL的8位除法器的实现
【摘 要】
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介绍了利用VHDL实现八位除法,采用层次化设计,给出了实现除法的子模块程序。使用Altera公司的MAX+PLUSI-I10.2开发软件进行功能仿真并给出仿真波形。
【机 构】
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军械工程学院训练部
【出 处】
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微计算机信息
【发表日期】
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2006年36期
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