NRS FPU中浮点乘,除运算的合并设计

来源 :计算机研究与发展 | 被引量 : 0次 | 上传用户：wo402179168

【摘要】

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ＮＲＳＦＰＵ是西北工业大学航空微电子中心研制的具有自主版权的协处理器，文中面向嵌入式应用描述了ＮＲＳＦＰＵ通用路径下浮点乘、除的合并设计。主要讨论了迭代计数器、除索引奇存器与乘数寄存

【作者】

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王迎春高德远

【出处】

：

计算机研究与发展

【发表日期】

：

2000年3期

【关键词】

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BOOTH 浮点处理器 FPU 浮点运算设计 BOOTH SRT PLA floating point processor FPU

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ＮＲＳＦＰＵ是西北工业大学航空微电子中心研制的具有自主版权的协处理器，文中面向嵌入式应用描述了ＮＲＳＦＰＵ通用路径下浮点乘、除的合并设计。主要讨论了迭代计数器、除索引奇存器与乘数寄存器的合用、ＢＯＯＴＨ译码逻辑与除法的查找表结合、以及数据缩放与移位部件的共用。并结合具体实现，对浮点除算法中实现较复杂的商位产生算法进行了改进。与其它几种常见的处理器比较显示，ＮＲＳＦＰＵ规模小，速度高，是嵌入式

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