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电子技术的发展日新月异,高速数字电路(即高时钟频率及快速边沿)的设计成为主流,给PCB设计带来许多问题和挑战.阐述了高速时钟电路设计过程中遇到的信号完整性问题,同时也给出了这些问题的解决方法.
高速时钟电路的信号完整性设计
【摘 要】
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电子技术的发展日新月异,高速数字电路(即高时钟频率及快速边沿)的设计成为主流,给PCB设计带来许多问题和挑战.阐述了高速时钟电路设计过程中遇到的信号完整性问题,同时也给
【机 构】
：
中国电子科技集团公司第54研究所
【出 处】
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电子工艺技术
【发表日期】
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2004年1期
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