【摘 要】
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针对DDS芯片因存储空间开销大导致功耗增加，可靠性降低的问题，设计了一种对直接数字频率合成（DDS）波形发生器在现场可编程门阵列（FPGA）上的ROM存储空间压缩优化算法。在不改变波形精度的前提下，通过存储幅度序列的相对增量来减少波形数据位宽的方式对ROM进行压缩，再利用幅度累加器就可以还原出真实的幅度序列。在Quartus Ⅱ 13.0开发环境下搭建工程，并在FPGA开发板上测试通过。经过测试，
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针对DDS芯片因存储空间开销大导致功耗增加，可靠性降低的问题，设计了一种对直接数字频率合成（DDS）波形发生器在现场可编程门阵列（FPGA）上的ROM存储空间压缩优化算法。在不改变波形精度的前提下，通过存储幅度序列的相对增量来减少波形数据位宽的方式对ROM进行压缩，再利用幅度累加器就可以还原出真实的幅度序列。在Quartus Ⅱ 13.0开发环境下搭建工程，并在FPGA开发板上测试通过。经过测试，该DDS信号发生器可产生5种不同的波形，共占据存储空间9 240 bit。结果表明，这种DDS优化算法比传统DDS波形发生器节省资源96%以上，能够减少系统功耗，提高系统运行速度。
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