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本文以分频比为2.5的半整数分频器的设计为例，介绍了在MAX＋plus Ⅱ开发软件下，利用VHDL硬件描述语言以及原理图的输入方式来实现半整数分频器的过程和方法。
基于CPLD／FPGA的半整数分频器的设计
【摘 要】
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本文以分频比为2.5的半整数分频器的设计为例，介绍了在MAX＋plus Ⅱ开发软件下，利用VHDL硬件描述语言以及原理图的输入方式来实现半整数分频器的过程和方法。
【机 构】
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兰州石化职业技术学院王林峰甘肃兰州730060
【出 处】
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科技创新导报
【发表日期】
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2009年22期
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