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本文针对门阵列和标准单元设计系统提出一种分级的时延驱动布局算法，前的时延驱动布局算法除了文献「２２」以外都不是分级的，因而运算时间很长，而且最长路径上的信号延迟达不到最优；而文献「２」「的算法只能处理时序关系是ＤＡＧ图的电路，也就是说，电路中不能包含寄存器元件。
分级的时延驱动布局算法
【摘 要】
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本文针对门阵列和标准单元设计系统提出一种分级的时延驱动布局算法，前的时延驱动布局算法除了文献「２２」以外都不是分级的，因而运算时间很长，而且最长路径上的信号延迟达不到最优
【机 构】
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清华大学计算机科学与技术系
【出 处】
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半导体学报
【发表日期】
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1997年3期
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