【摘 要】
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随着集成电路尺寸缩小和低电压技术的发展,集成电路会出现在工艺、电压、温度及老化等方面的变化（Variation）,会使得当前集成电路的时序发生变化,经过各级寄存器的逐渐累积后使
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随着集成电路尺寸缩小和低电压技术的发展,集成电路会出现在工艺、电压、温度及老化等方面的变化（Variation）,会使得当前集成电路的时序发生变化,经过各级寄存器的逐渐累积后使得电路发生时序错误（Timing Error）,当前时序错误检测与纠正技术正得到越来越多的研究。文中基于SMIC 65nm工艺,针对当下最新的iRazor结构,完成全定制只需要额外增加三个晶体管的iRazor FF结构的硬件实现并完成时序错误纠正电路的改进和优化设计。在此基础上,设计一款FIR数字滤波器作为验证电路,使EDAC技术应
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