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介绍了用于SDH系统中E1接口电路——数字分接复用器的专用集成电路(ASIC)的VHDL电路设计及FPGA实现。该分接复用器电路用纯数字同步方式实现，可完成SDH系统接口电路中7路(可扩展成N路)E1数据流的分接和复用。该设计输入采用VHDL和状态转移图。
SDH中E1接口数字分接复用的ASIC电路设计与实现
【摘 要】
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介绍了用于SDH系统中E1接口电路——数字分接复用器的专用集成电路(ASIC)的VHDL电路设计及FPGA实现。该分接复用器电路用纯数字同步方式实现，可完成SDH系统接口电路中7路(可扩
【机 构】
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西安邮电学院ASIC设计中心
【出 处】
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西安邮电学院学报
【发表日期】
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2001年1期
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