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双域乘法器在椭圆曲线密码学中具有重要意义，是构成双域模乘器的重要组件．考虑到双域乘法器的关键路径主要由GF（p）域决定；因此，在传统的基4Booth编码乘法器的基础上进行优化设计，改进部分积产生电路以及Wallace压缩电路，使其能够同时支持GF（p）域和GF（2m）域．设计的双域乘法器在FPGA实现结果表明，双域乘法器比单独实现两个域面积减小16．9％；延时比单独的GF（p）域增加1．188ns．将设计的双域乘法器应用到模乘器，结果表明，该设计完成一次256bit的模乘操作比已有的在时间上节约了7．35