基于CPLD的HDB3编译码器

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【摘要】

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通过对HDB3编译码原理的分析,提出了一种基于可编程逻辑器件EPM7064SLC44和模拟开关4052实现HDB3编译码的方法,给出了硬件设计电路图、软件设计流程和HDB3编译码器的仿真波形

【作者】

：

贾惠彬王兰勋

【机构】

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河北大学电子信息工程学院

【出处】

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电子科技

【发表日期】

：

2005年9期

【关键词】

：

HDB3码 CPLD VERILOG语言 HDB3 code CPLD Verilog language

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通过对HDB3编译码原理的分析,提出了一种基于可编程逻辑器件EPM7064SLC44和模拟开关4052实现HDB3编译码的方法,给出了硬件设计电路图、软件设计流程和HDB3编译码器的仿真波形.此实现方法具有硬件设计简单、运行速度快、成本低等优点.同时由于CPLD可重复编程的特点,可以对它进行在线修改,便于设备的调试和运行.此编译码器已经过实际测试,运行稳定可靠,可用于实际电路中.

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