【摘 要】
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针对连续时间级联Σ-Δ调制器的设计,提出了一种完整的系统综合设计方法,它主要包括结构综合设计阶段、高级尺寸调整阶段和电路级尺寸调整阶段。在结构综合设计阶段,设计空间探索和传输规范依赖于某种性能评估与优化器的交互来构建合适的成本函数,尝试获得满足调制器性能指标的可选体系结构的集合;在高级尺寸调整阶段,自动尺寸调整过程采用行为仿真器以及全局优化程序来得到在仍然满足调制器性能指标的情况下可接受的不同构建模块的非理想性的最大值;在电路级尺寸调整阶段,通过将电气仿真器与全局优化过程相结合来调整各构建模块的尺寸,以满
【机 构】
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江苏电子信息职业学院智能制造学院,河北工程大学信息与电气工程学院
【基金项目】
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江苏省“333工程”科研资助项目(BRA2019304)。
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针对连续时间级联Σ-Δ调制器的设计,提出了一种完整的系统综合设计方法,它主要包括结构综合设计阶段、高级尺寸调整阶段和电路级尺寸调整阶段。在结构综合设计阶段,设计空间探索和传输规范依赖于某种性能评估与优化器的交互来构建合适的成本函数,尝试获得满足调制器性能指标的可选体系结构的集合;在高级尺寸调整阶段,自动尺寸调整过程采用行为仿真器以及全局优化程序来得到在仍然满足调制器性能指标的情况下可接受的不同构建模块的非理想性的最大值;在电路级尺寸调整阶段,通过将电气仿真器与全局优化过程相结合来调整各构建模块的尺寸,以满
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