基于FPGA的2Tap模式Cameralink视频与LVDS视频叠加器的设计与实现

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本设计针对2Tap模式Cameralink摄像头采集到的高清视频信号进行了数据解码、缓存、同步控制、叠加等操作,实现了Cameralink视频与LVDS视频的叠加显示。视频处理在FPGA内进行,充分利用了FPGA延迟小、能力强的特点,可以做到高清视频数据实时叠加显示。
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