【摘 要】
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针对高速、高阶成型滤波器的实现问题,在传统分布式DA算法的基础上,提出一种改进算法.利用升采样过程中内插零的结构特点,使用逻辑单元LUT代替存储ROM,减少了有效地址位数,提
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针对高速、高阶成型滤波器的实现问题,在传统分布式DA算法的基础上,提出一种改进算法.利用升采样过程中内插零的结构特点,使用逻辑单元LUT代替存储ROM,减少了有效地址位数,提高了寻址速度;利用表分割算法和滤波器系数的对称性,并通过增加流水线结构,进一步节约了存储资源的消耗,提升了运算速度.通过与商用FIR IP核（DA算法）的实测对比,所提算法最大实现速率有所提高,且在高阶滤波器设计时不受硬件ROM大小和数量的限制,有效改善了逻辑资源的使用情况.
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