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针对B码时统终端的精度、稳定性等问题,结合B码的编解码和北斗/GPS双模授时的原理,从应用角度出发,提出一种利用可编程逻辑器件(FPGA)采集双模授时的时钟和时统终端的设计方法。结果表明:从接收器采集到的秒头和B码的秒头误差控制在纳秒级,从而达到同步授时的效果。
北斗／GPS双模授时的B码时统终端设计
【摘 要】
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针对B码时统终端的精度、稳定性等问题,结合B码的编解码和北斗/GPS双模授时的原理,从应用角度出发,提出一种利用可编程逻辑器件(FPGA)采集双模授时的时钟和时统终端的设计方法。结果表明:从接收器采集到的秒头和B码的秒头误差控制在纳秒级,从而达到同步授时的效果。
【机 构】
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安徽理工大学电气与信息工程学院
【出 处】
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电测与仪表
【发表日期】
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2013年08期
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